西門子數(shù)字化工業(yè)軟件近日推出 tessent™ rtl pro 創(chuàng)新軟件解決方案，旨在幫助集成電路 (ic) 設(shè)計團隊簡化和加速下一代設(shè)計的關(guān)鍵可測試性設(shè)計 (dft) 任務(wù)。

隨著 ic 設(shè)計規(guī)模不斷增大、復雜性持續(xù)增長，工程師需要在設(shè)計早期階段發(fā)現(xiàn)并解決可測試性問題，西門子的 tessent 軟件可以在設(shè)計流程早期階段分析和插入大多數(shù) dft 邏輯，執(zhí)行快速綜合，運行 atpg(自動測試向量生成)，以發(fā)現(xiàn)和解決異常模塊并采取適當?shù)拇胧?，滿足客戶不斷增長的需求。

tessent rtl pro 進一步擴展了 tessent 產(chǎn)品組合的設(shè)計編輯功能，可在設(shè)計流程早期自動完成測試點、封裝器單元和 x-bounding 邏輯的分析和插入，有助于客戶縮短設(shè)計周期，改進設(shè)計的可測試性。與其他解決方案不同，tessent rtl pro 可處理復雜的 verilog 和 systemverilog 結(jié)構(gòu)，同時保持原始 rtl 設(shè)計的風格。

半導體公司 renesas 目前已采用 tessent rtl pro 來推進其“左移” (shift-left) 工作。renesas electronics corporation 共享研發(fā) eda 業(yè)務(wù)部數(shù)字設(shè)計技術(shù)部門資深 eda 主任工程師 tatsuya saito 表示：“使用 tessent rtl pro 進行下一代汽車半導體設(shè)計，能夠幫助 renesas 延續(xù)左移策略，減少傳統(tǒng)設(shè)計流程的迭代次數(shù)，我們現(xiàn)在不僅可以完成這個既定目標，同時還能保持一流的覆蓋率和向量數(shù)量，為后端和驗證團隊提供包含 tessent ip(包括 rtl 中的 versapoint 測試點)的相同完整設(shè)計視圖，這對 renesas 提升競爭力而言至關(guān)重要。”

新解決方案與西門子 tessent dft 工具配合使用能夠?qū)崿F(xiàn)先進功能，tessent rtl pro 能夠分析 rtl 復雜性及其對測試點插入的適應(yīng)性，從而評估是否能夠高效地編輯用戶的 rtl 結(jié)構(gòu)，這是在整個設(shè)計過程中添加測試點時的一個關(guān)鍵因素，能夠幫助用戶縮短設(shè)計周期，加快產(chǎn)品上市速度。

在綜合之前添加 dft 邏輯時，tessent rtl pro 的“左移”功能有助于增強第三方工具優(yōu)化面積和時序的能力，在門級電路中只需執(zhí)行掃描鏈插入。設(shè)計插入在 rtl 開發(fā)階段進行，利用 rtl 輸出，實現(xiàn)與第三方綜合和驗證軟件的無縫集成。此外，rtl pro 生成的設(shè)計文件可與任何下游的綜合或驗證流程配合使用，而無需封閉流程。

西門子數(shù)字化工業(yè)軟件 tessent 部門副總裁兼總經(jīng)理 ankur gupta 表示：“tessent rtl pro 繼續(xù)履行西門子的使命，為芯片設(shè)計人員和 dft 工程師提供業(yè)界領(lǐng)先的解決方案，用于其設(shè)計流程。由于能夠在設(shè)計的 rtl 階段中分析和插入封裝器單元、x-bounding 邏輯和 versapoint 測試點，客戶現(xiàn)在可以顯著提高其設(shè)計的可測試性，從而進一步推進其左移計劃。”